blog de avelino herrera morales

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  - Diseño e implementación de un procesador RISC desde cero (III)
    14/04/16
    En la anterior entrega de la serie se llegó hasta la fase de simulación y se comprobó, usando el software GHDL, el funcionamiento del procesador V1. En esta tercera entrega se ha implementado y probado el diseño en una FPGA real: una Spartan-3E de Xilinx.
    
    >>> Enlace a la segunda
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