blog de avelino herrera morales

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  - Diseño e implementación de un procesador RISC desde cero (II)
    23/03/16
    En esta segunda entrega de la serie se profundiza en el diseño de la unidad de control, en la implementación en VHDL de los diferentes elementos y en la realización de una prueba de concepto sobre un simulador.
    
    >>> Enlace a la primera entrega de la serie.
    
    Lógica combin
  - Diseño e implementación de un procesador RISC desde cero (I)
    22/03/16
    Mediante este post empiezo a realizar una serie de entradas en las que iré abordando el diseño y la implementación en VHDL de un procesador RISC sencillo al que he llamado V1. La complejidad y lo extenso del tema obligan a dividir el proyecto en varios posts que iré publicando a medida que vaya alca
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